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B.概要设计和过程设计
C.接口设计和过程设计
D.接口设计和详细设计
(1)简要给出设计步骤;
(2)画出逻辑电路图.
开始时R键使跑表为零初始状态。在R键无效的时候,按一下S键则计时器开始计时,在此计时状态下,按一下S键暂停计时,再按一下S键则继续计时,并且这一过程可由S键控制重复进行。如果在暂停状态按一下R键,跑表被清零。
如果在计时状态下,按一下R键则暂停计时,再按一下R键则继续计时,并且这一过程也可由R键控制重复进行。当按R键使计时暂停时,再按S键不起作用。
要求跑表的计时范围为0.01s~59min59.99s,计时精度为10ms;跑表的输出能够直接驱动共阳极7段数码管显示。输入信号的频率为100 Hz。
(1)画出跑表的结构框图。
(2)画出控制单元的ASM图及状态图。
(3)用Verilog HDL描述跑表的功能。
(a)假设。
证明:若Hc(s)=K,称为比例(proportional)控制或P控制,就能够选择K值,以稳定该系统,并使得在x(t)=δ(t)时,有e(t)→0。证明:若x(t)=u(t),就不能得到e(t)→0。
(b)再次设Hp(s)为式(P11.57-1),并设想采用比例加(proportional-plus-integral,PI)控制,即
证明:用一个比例加积分控制器不能稳定这个系统。但是,如果采用比例加积分加微分(proportional-plus-integral-plus-differential,PID)控制,即
就能稳定这个系统,并让它能跟踪一个阶跃的变化。
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