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[单选题]

3个触发器可以构成能寄存()位二进制数码的寄存器。

A.3

B.6

C.8

D.9

提问人:网友zzx1986928 发布时间:2022-01-07
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第1题
N个触发器可以构成能寄存()位二进制数码的寄存器。

A、N-1

B、N

C、N+1

D、2N

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第2题
寄存器至少需要()个触发器构成
A.2

B.3

C.4

D.8

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第3题
一个数字系统的数据处理单元由触发器E和F、4位二进制计数器A以及必要的门电路组成。计数器的各位为A4、A3、A2、A1系统开始处于初始状态,当信号S=0,系统保持在初始状态;当S=1时,计数器A和触发器F清零。从下一个时钟脉冲开始,计数器进行加1计数,直到系统操作停止。A4和A3的值决定了系统的操作顺序。

当A3=0时,触发器E清零,计数器继续计数。

当A3=1时,触发器E置1,并检测A4,A4=0时,继续计数;A4=1时,触发器F置1,并停止计数,回到系统初始状态。

(1)试画出该系统的ASM图

(2)画出该系统控制单元的状态图,并用D触发器及必要的门电路设计控制单元

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第4题
一位RS触发器可存储一位二进制数()

此题为判断题(对,错)。

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第5题
判断题: 3位二进制计数器可以构成模值为23+1的计数器。
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第6题
要实现对50位二进制数的存储功能,电路需要()个触发器构成
A.25

B.50

C.100

D.500

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第7题
用两个四位二进制计数器级联构成一个计数器,其计数的最大模数为( )

A、8

B、16

C、126

D、256

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第8题
设计一个具有借位功能的1位二进制减法器,并画出逻辑电路图。
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第9题
试用4个负边沿触发的JK触发器构成一个异步二进制加法计数器,要求画出逻辑图和输出波形。

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第10题
使用74161同步置数功能实现12进制计数器,计数器从0000状态开始计数,应在( )状态完成置数。

A、1011

B、1100

C、1101

D、1110

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