题目内容
（请给出正确答案）
[单选题]
由PC内容指定ROM地址单元中取出的指令，放于（）。
A.运算器与控制器
B. 运算器与存储器
C. 指令寄存器和指令译码器
D. 控制器与存储器
提问人：网友sniperb43
发布时间：2022-01-06
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第2题
设用八进制数表示下列单元地址及内容:寄存器R3中放000015 ,程序计数器PC中放002000（均为八
设用八进制数表示下列单元地址及内容:
寄存器R3中放000015 ,程序计数器PC中放002000(均为八进制),试求表7.3中的有效地址EA和指令执行后R1或PC的内容(均用八进制表示)。
说明:
(1)LDA表示取数指令,后面的1表示R1,逗点后的第一个数为形式地址(或位移量),用八进制表示,@表示间接寻址，*表示相对寻址，第二个逗点后的3表示用R3作为变址寄存器。JMP为无条件转移指令。
(2)表中⑧和⑩为复合寻址方式，前者为先变址再间址,后者为先相对寻址再间址。
(3)间接访问某一存储单元时,存储字的最高位用于区分是否多次间址,低15位表示有效地址。如取出的数据最高位为“0",则为一次间址,如取出的数据最高位为“1",则有多次间接寻址功能。
第3题
设用十六进制数表示下列单元地址及内容:寄存器R3中放000D,程序计数器PC中放0400（均为十六进制
设用十六进制数表示下列单元地址及内容:
寄存器R3中放000D,程序计数器PC中放0400(均为十六进制),试求表7.4中的有效地址EA和指令执行后R1或PC的内容(均用十六进制表示)。
说明:
(1) LDA表示取数指令,后面的1表示R1,逗点后的第一个数为形式地址(或位移量)，用十六进制表示,@表示间接寻址，*表示相对寻址,第二个逗点后的3表示用R3作变址寄存器。JMP为无条件转移指令。
(2)表中⑧和⑩为复合寻址方式，前者为先变址再间址,后者为先相对寻址再间址。
(3)间接访问某一存储单元时,存储字的最高位用于区分是否多次间址，低15位表示有效地址。如取出的数据最高位为“0",则为一次间址,如取出的数据最高位为“1”,则有多次间接寻址功能。
第4题
堆栈是一个专门的存储区域，访问堆栈时，不需要程序人员指定堆栈单元的地址，要存取的堆栈单元地址
是由(3)给出的，并且在堆栈操作中这个地址是自动修改的。存取堆栈时存入取出的数据的先后顺序是(4)，这对中断操作提供了很大方便。
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A．SP
B．PC
C．指令地址码
D．程序
第5题
模型机数据通路结构由CPU内总线、逻辑运算部件ALU、输入选择器A和B、输出移位器、通用寄存器R0～R3、暂
存器C和D、地址寄存器MAR、数据缓冲寄存器MDR、指令寄存器IR、程序计数器PC、堆栈指针SP组成。(电子科大2006) (1)模型机传送指令MOV(R0)，(SP)+；其源采用自增型寄存器间址，目的采用寄存器 间址。用寄存器传送语句(如PC→MAR)拟出该指令的流程。 (2)转移指令JMP X(PC)；转移地址采用相对寻址，位移量存放在现行指令所在单元的下一个单元中，以位移量地址为基准进行转移。该指令的流程如下。读懂该流程，并为每题选择一个正确答案。 取指周期FT：M→IR IR的内容为______________ PC+1→PC PC的内容为______________ 执行周期ET：PC→MAR MAR的内容为______________ M→MDR→C C的内容为______________ PC+C→PC MAR的内容为______________ ①现行指令 ②下条指令 ③源操作效 ④位移量 ⑤源地址 ⑥位移量地址 ⑦现行指令地址 ⑧转移地址
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第6题
为了确定下一条微指令的地址，通常采用断定方式，其基本思想是（)。
A.用程序计数器PC来产生后继微指令地址
B.通过微指令顺序控制字段由设计者指定或由设计者指定的判别字段控制产生后继微指令地址
C.用微程序计数器μPC来产生后继微指令地址
D.通过指令中指定一个专门字段来控制产生后继微指令地址
第7题
设相对寻址的转移指令占两个字节,第一字节是操作码,第二字节是相对位移量（用补码表示),若CPU每当从存储器取出一个字节时,即自动完成（PC)＋1－→PC。设当前PC的内容为2009H,要求转移到2000H地址,则该转移指令第二字节的内容应为（)
A. F5H
B. F7H
C.09H
第8题
设相对寻址的转移指令占两个字节,第一字节是操作码,第二字节是相对位移量（用补码表示) ,若CPU每当从存储器取出一个字节时,即自动完成（PC)＋1→PC,设当前PC的内容为2000H,要求转移到2008H地址,则该转移指令第二字节的内容应为（)
A.08H
B.06H
C.0AH
第10题
从进程发出指定逻辑地址的访问请求，经过地址变换，到在内存中找到对应的实际物理地址单元并取出数
据，所需要花费的总时间，称为内存的有效访问时间（Effective Access Time，EAT） 假设访问一次内存的时间为100ns，访问一次快表的时间为20ns。 在基本分页存储管理（没有快表）方式中，一个访存指令的EAT是多少？ 在引入快表的分页存储管理方式中，如果快表的命中率为80%，访存指令的EAT是多少？如果快表的命中率是90%呢？
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