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[主观题]

用逻辑门设计一个多输出逻辑电路,输入为8421BCD码,输出为3个检测信号。要求: (1) 当检测到输入数字能被4整除时,F1=1。 (2) 当检测到输入数字大于或等于3时,F2=1。 (3) 当检测到输入数字小于7时,F3=1。

提问人:网友Dym112233 发布时间:2022-01-07
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第1题
本次课实验内容: 1.设计一个判断4位BCD码数值的组合逻辑电路实验,它接受8421BCD码B3B2B1B0,仅当4<B3B2B1B0<9时,输出Y=1; 2.设计一个判断输血者与受血者血型是否符合规定的组合逻辑电路。
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第2题
设计一个判断输入8421码表示的十进制数是否大于5的组合逻辑电路,至少需要( )个逻辑门。

A、1

B、2

C、3

D、4

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第3题
四位超前进位全加器CT74LS283是对两个8421码作加法运算的集成电路。
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第4题
用与非门(含非门)设计一个译码线路.输入(A,B,C,D)为8421BCD码,输出控制7段显示管的f极,高电平时f极亮,如图10.80所示,写出F(ABCD)逻辑式,画出逻辑线路图.

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第5题
若要设计一个8位数值比较器,需要的数据输入和输出端口数分别是

A、8,3

B、16,3

C、8,8

D、16,16

E、16,8

F、16,3

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第6题
分别用逻辑门和VHDL语言设计一个8421码转换成5421码的码组变换电路。

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第7题
下图为由双4选1数据选择器74LS153和门电路组成的组合逻辑电路,则输出Z与输入X3X2X1X0之间的逻辑关系是:

A、检测8421BCD码

B、全加器

C、编码器

D、偶数“1”检测器

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第8题
用MSI译码器和逻辑门,设计下列码组变换电路:

(1)8421码转换成余3码;

(2)8421码转换成2421码;

(3)8421码转换成格雷码。

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第9题
试用译码器 74LS138 和适当的逻辑门设计一个组合电路。该电路输入X与输出L均为三位二进制数。二者之间的关系如下: 当 2≤X≤5 时 L = X + 2 当 X<2 时 L = 1 当 X>5 时 L = 0
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