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[主观题]

MIPSR4000整型流水线共有()段,和DLX流水线不同,R4000特别考虑了流水访问()的操作。

提问人:网友Lancelou 发布时间:2022-01-06
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第1题
MIPSR4000整型流水线是一种()流水线,共分为()段
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第2题
MIPSR4000整型流水线采用的是8段流水线结构。()
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第3题
MIPSR4000处理器中,对指令存储器和数据存储器的访问在流水线中都是一个时钟周期完成。()
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第4题
假设指令流水线分取指(IF)、译码(ID)、执行(EX)、回写(WR)四个过程段,共有10条指令连续输入此流水线

假设指令流水线分取指(IF)、译码(ID)、执行(EX)、回写(WR)四个过程段,共有10条指令连续输入此流水线。 (1)画出指令周期流程。 (2)画出非流水线时空图。 (3)画出流水线时空图。 (4)假设时钟周期为100 ns,求流水线的实际吞吐量(单位时间执行完毕的指令数)。 (5)求该流水处理器的加速比。

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第5题
整型共有几种子类型

A.1

B.2

C.3

D.4

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第6题
在基本的DLX流水线数据通路中,一共有四个多路选择器。()
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第7题
在基本的DLX流水线数据通路中,一共有三个多路选择器。()
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第8题
对于4段的指令流水线,若各段的时间均为100ns,共有7条指令连续输入此流水线,则该流水处理器的加速比为____________
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第9题
根据以下说明,写出正确的说明语句。 grid是一个二维数组,共有4行,10列整型元素 ___
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第10题
在一个四级指令流水线中,假设时钟周期为50 ns,共有30条指令连续输入此流水线,试求该流水线的最大吞吐率、实际吞吐率和加速比。

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