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[主观题]

下降触发器边沿JK触发器CT74LS112的RD’=1,SD’=1,且 J=1,K=1时,如时钟脉冲CP输入频率为110KHZ的方波,则Q端输出脉冲的频率为 ()

A,110KHZ

B,55KHZ

C,50KHZ

D,220KHZ

提问人:网友Dym112233 发布时间:2022-01-07
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第1题
下降沿触发器边沿 JK 触发器 CT74LS112 的R D ’ =1,S D ’=1,且 J=1,K=1 时,如时钟脉冲 CP 输入频率为 100kHz 的方波,则Q 端输出脉冲的频率为()
A.110kHz

B.55kHz

C.50kHz

D.220kHz

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第2题
集成触发器芯片74LS74是( )触发方式( )触发器

A、下降沿,JK

B、上升沿,JK

C、下降沿,D

D、上升沿,D

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第3题
下图是边沿触发的JK触发器,设初态为0,按如图所给出的J 、K、CP输小波形, 画出触发器Q端的输出波形图。
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第4题
已知后沿主从触发的JK触发器,J和K端的输入信号波形如图所示,而且已知触发器原为0态,求输出端Q的波形。
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第5题
由D触发器组成电路如图所示:[图],则正确的输出波形为(...

由D触发器组成电路如图所示:,则正确的输出波形为( )。

A、A

B、B

C、C

D、D

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第6题
一片74LS00芯片中集成了几个二输入的与非门?

A、1

B、2

C、3

D、4

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第7题
下面边沿JK触发器的状态只可能在时钟的上升沿改变,这个说法是否正确?
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第8题
上升沿触发的D型触发器的异步置0、置1端分别为[图]时,...

上升沿触发的D型触发器的异步置0、置1端分别为时,触发器的次态 。

A、为0

B、与CP和D有关

C、只与CP正边沿有关

D、为1

E、只与D有关

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第9题
要将维持阻塞D触发器CT74LS74输出Q置为低电平0,则输入为( )。

A、D=0,`RD=1,`SD=1,输入CP负跃变

B、D=1,`RD=1,`SD=1,输入CP正跃变

C、D=1,`RD=1,`SD=0,输入CP正跃变

D、D=1,`RD=0,`SD=1,输入CP正跃变

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