![](https://lstatic.shangxueba.com/jiandati/h5/images/m_q_title.png)
[主观题]
使用Verilog设计一个8选1选择器
提问人:网友lixiaoj
发布时间:2022-01-07
A.相比于二进制译码器,数据选择器更适合实现多输出逻辑函数。
B.要实现一个四输入逻辑函数,使用16选1数据选择器最合适。
C.要实现一个三输入逻辑函数,不能使用4选1数据选择器。
D.要实现一个四输入逻辑函数,可以先使用4选1数据选择器扩展为8选1数据选择器,再应用实现。
试用一片74161、一片8选1数据选择器和少量“非”门设计一个可控序列码发生器。要求:
当X=0时,Z=1011010
当X=1时,Z=10011
试用4位二进制计数器74HC163、8选1数据选择器CD4512及必要的逻辑门设计一个能产生1001110100(时间顺序为自左向右)的序列脉冲发生器。
设计一个11110000100序列信号产生器。 (1)用MSI计数器74161和8选1数据选择器74151实现设计。 (2)选择适当的GAL器件实现设计,并编写相应的VHDL语言程序,在ispLEVER开发系统中完成仿真和进行器件适配。
为了保护您的账号安全,请在“简答题”公众号进行验证,点击“官网服务”-“账号验证”后输入验证码“”完成验证,验证成功后方可继续查看答案!