一个数据流图(Data Flow Diagram,DFD)表示系统中被计算值之间的功能关系,包括______、______、______。
一个数据流图(Data Flow Diagram,DFD)表示系统中被计算值之间的功能关系,包括______、______、______。
一个数据流图(Data Flow Diagram,DFD)表示系统中被计算值之间的功能关系,包括______、______、______。
下列Verilog HDL程序所描述电路功能是( ) module Dataflow( A, En, Y); input [2:0] A; //输入端口声明 input En; //输入端口声明 output [7:0]Y; //输出端口声明 assign Y[0] = ~( En & ~A[2] & ~A[1] & ~A[0] ); assign Y[1] = ~( En & ~A[2] & ~A[1] & A[0] ); assign Y[2] = ~( En & ~A[2] & A[1] & ~A[0] ); assign Y[3] = ~( En & ~A[2] & A[1] & A[0] ); assign Y[4] = ~( En & A[2] & ~A[1] & ~A[0] ); assign Y[5] = ~( En & A[2] & ~A[1] & A[0] ); assign Y[6] = ~( En & A[2] & A[1] & ~A[0] ); assign Y[7] = ~( En & A[2] & A[1] & A[0] ); endmodule
A、8/3线编码器
B、3/8线译码器
C、加法器
D、数据选择器
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