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[主观题]

试根据图4.4.31和图4.4.32所示的数值比较器逻辑图,使用分模块、分层次设计方法,对两位数值比较

器的行为进行描述。要求如下:

试根据图4.4.31和图4.4.32所示的数值比较器逻辑图,使用分模块、分层次设计方法,对两位数值比

(1)首先根据图4.4.31对1位数值比较器的行为进行描述,并用Quartus II软件对该模块进行逻辑功能仿真,并给出仿真波形。

(2)然后根据图4.4.32结构,调用上面设计的1位比较器模块和基本门级元件,完成成两位数值比较器的建模。

(3)最后用QuartusII软件对整个电路进行逻辑功能仿真,并给出仿真波形。

提问人:网友yaoshiyu 发布时间:2022-03-16
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第1题
下图所示电路的逻辑功能为()

A.数值比较器

B.编码器

C.1位全减器

D.1位全加器

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第2题

A.编码器

B.译码器

C.D触发器

D.数值比较器

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第3题
74LS138译码器的输入三个使能端为,使用该芯片设计的逻辑电路如下图所示,分析该电路的功能。

A.全加器

B.编码器

C.数值比较器

D.全减器

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第4题

A.编码器

B.D触发器

C.数值比较器

D.译码器

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第5题
分析下图电路的逻辑功能

A.译码器

B.数值比较器

C.数据选择器

D.全减器

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第6题
下图所示电路的逻辑功能为:

A.1位全加器

B.1位全减器

C.编码器

D.数值比较器

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第7题
根据图4.4.5所示的逻辑图, 使用分模块、分层次设计方法,对16线-4线优先编码器的行为进行描述。要
求如下:

(1)首先根据8线-3线优先编码器CD4532的功能表,写出该编码器的行为级描述,并用QuartusII软件对该模块进行逻辑功能仿真,并给出仿真波形。

(2)然后调用上面设计的编码器子模块和基本门级元件,完成16线-4线优先编码器的建模。

(3)最后用QuartusII软件对整个电路进行逻辑功能仿真,并给出仿真波形。

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第8题
下图所示电路的逻辑功能为:

A.1位全加器

B.1位全减器

C.编码器

D.数值比较器

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第9题
下图所示电路的逻辑功能为:

A.1位全加器

B.1位全减器

C.编码器

D.数值比较器

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第10题
图示所示电路为?

A.单限比较器

B.反相滞回比较器

C.同相滞回比较器

D.窗口比较器

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第11题
7485是四位数值比较器。可以用它扩展成9位数值比较器。
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