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[主观题]
用一片4-16线译码器和适当的逻辑门设计一个1位十进制数2421码的奇偶位产生电路（假定采用奇检验)。
提问人：网友yanjingjing2019
发布时间：2022-06-13
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第1题
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用3线-8线译码器74HC138和门电路设计1位二进制全减器电路。输入为被减数、减数和来自低位的借位；输出为两数之差和向高位的借位信号。
第3题
用与非门设计一个1位数值范围判别电路。十进制数用8421BCD码表示。当输入的十进制数大于等于5时，电路输出为1，当输入的十进制数小于等于4时，输出为0。画逻辑电路图是（)
A.
B.
C.
D.
第5题
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第6题
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集成3-8译码器74LS138逻辑图如图3.10所示,要求用此3-8译码器和适当的逻辑门(规定与非门)设计一个全减器;设Ai为被减数,Bi为减数,低位向该位的借位为小差为Di向高位借位为Ji+1.
(1)列出全减器真值表;(2)写出函数逻辑表达式;(3)画出实现逻辑电路图.
第7题
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设计一个一位十进制数(8421BCD码)乘以5的组合逻辑电路，电路的输出为十进制数(8421BCD码)。实现该逻辑功能的逻辑电路图是否不需要任何逻辑门？
第9题
用与非门设计一个1位数值范围判别电路。十进制数用8421BCD码表示。当输入的十进制数大于等于5时，电路输出为1，当输入的十进制数小于等于4时，输出为0。对逻辑函数式化简成与非式是（)
A.
B.
C.
D.
第11题
用与非门设计一个1位数值范围判别电路。十进制数用8421BCD码表示。当输入的十进制数大于等于5时，电路输出为1，当输入的十进制数小于等于4时，输出为0。对逻辑函数式化简成最简与或式是（）
A、Y=A+BC
B、
C、
D、Y=A+BD
