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[主观题]

试用中规模同步十进制加法计数器CT74160,并附加必要的门电路,设计一个273进制计数器.

提问人：网友18***590 发布时间：2022-06-11

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第1题

试用JK触发器和必要的逻辑门设计一个同步六进制加法计数器。

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第2题

CT74160是一种( )集成电路。

A.4D锁存器

B.4位同步二进制加法计数器

C.具有三态输出的4D锁存器

D.同步十进制加法计数器

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第3题

试用4位同步二进制计数器74LS161接成十二进制计数器，标出输入、输出端，可以附加必要的门电路。

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第4题

试用集成中规模异步二－五－十进制计数器CT74LS290设计一个输出为对称方波的十进制计数器。

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第5题

试用同步十进制加法计数器74LS160设计一个四十八进制计数器.74LS160的功能表如表6-4.

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第6题

用两片同步十进制计数器74160设计一个六十进制计数器。要求个位和十位之间按十进制连接。请标明计数输入端和进位输出端。可以附加必要的门电路。

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第7题

试用边沿JK触发器设计一个同步五进制加法计数器，并检查能否自启动。

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第8题

用同步十进制计数器74160接成五进制计数器，并注明计数输入端和进位输出端。允许附加必要的门电路。

用同步十进制计数器74160接成五进制计数器，并注明计数输入端和进位输出端。允许附加必要的门电路。

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第9题

试用边沿 D 触发器设计一个同步十进制计数器。

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第10题

图P5.18是由二进制优先权编码器CT74LS147（真值表参见表P5.18)和同步十进制加法计数器CT74160

图P5.18是由二进制优先权编码器CT74LS147(真值表参见表P5.18)和同步十进制加法计数器CT74160组成的可控分频器.试说明当输入控制信号分别为低电平,并假定CP脉冲的频率为f₀时,由Z端输出的脉冲的频率是多少？

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第11题

试用上升沿触发的D触发器和门电路设计一个同步三进制减计数器。

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