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[主观题]
用同步二进制加法计数器74161（逻辑符号及功能表见附录)和一个3－8线译码器74138以及门电路设计一个具有开机
用同步二进制加法计数器74161(逻辑符号及功能表见附录)和一个3-8线译码器74138以及门电路设计一个具有开机消零功能的模7计数器，要求计数器按下列规律计数，要求写出设计过程，画出电路图：
0，4，9，12，3，6，9，0，4，…
提问人：网友anonymity
发布时间：2022-01-06
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第2题
如图所示逻辑电路为（ ）。 [图]A、同步二进制加法计数器B...
如图所示逻辑电路为（ ）。
A、同步二进制加法计数器
B、异步二进制加法计数器
C、同步二进制减法计数器
D、异步二进制减法计数器
第3题
6、由集成四位二进制同步计数器74161和8选1数据选择器74LS151组成的电路如图所示。试按要求回答： （1）74161组成几进制计数器电路； （2）画出计数状态转换图； （3）写出输出Y的序列信号的一个周期。 
第4题
已知74161是异步清零、同步置数的4位二进制计数器。用74161实现5进制计数器，可以（）。
A、采用清零法，当电路状态进入到0100（高位在前）时产生清零信号来清零
B、采用清零法，当电路状态进入到0101（高位在前）时产生清零信号来清零
C、采用置数法，当电路状态进入到0100（高位在前）时产生置数信号，置数为0000
D、采用置数法，当电路状态进入到0101（高位在前）时产生置数信号，置数为0000
第5题
逻辑分析题
4位同步二进制计数器74161的功能表如表所示，Q3为高位输出，C为与时钟同步的进位输出，进入1111状态且ENT=1时，由C端输出一个周期的正脉冲。
| CP | R_{bar{D}} | bar{LD} | ENP | ENT | Q3 | Q2 | Q1 | Q0 |
| varphi | 0 | varphi | varphi | varphi | 0 | 0 | 0 | 0 |
| ↑ | 1 | 0 | varphi | varphi | D3 | D2 | D1 | D0 |
| varphi | 1 | 1 | 0 | 1 | 保持 | |||
| varphi | 1 | 1 | varphi | 0 | 保持(但C=0) | |||
| ↑ | 1 | 1 | 1 | 1 | 加法计数 | |||
第6题
图10.66所示为四位二进制加法计数器,其功能表见表10.16所示.试将两片CT74161采用同步级联方式及总体反馈归零法设计成一个23进制计数器,要求写出设计过程并画出连接图.
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第7题
试用二进制同步计数器CT74161设计一个可控BCD码计数器.电路有一个控制端K,当K=0时,电路为8421BCD码计数器;当K=1时,电路为2421BCD码计数器.规定设计电路采用反馈置数法.要求写出设计过程,画出电路图(2421BCD码见表10.7(a),CT74161逻辑符号和功能表见图10.44和表10.7(b)).
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