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[主观题]

用并行加法器74283设计一个8421码对9求补的逻辑电路。

提问人：网友zzq0538 发布时间：2022-01-07

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第1题

4-11 用集成加法器74283及必要的门电路，设计4位8421码与余3码的互转电路。

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第2题

用ispLS11032设计1个1位十进制计数（8421码表示)的加法器。

用ispLS11032设计1个1位十进制计数(8421码表示)的加法器。

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第3题

用ispLSll032设计1个1位十进制计数（8421码表示)的加法器。

用ispLSll032设计1个1位十进制计数(8421码表示)的加法器。

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第4题

用4位全加器74283及一些必要的门电路，设计4位的8421码与余3码互转电路。

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第5题

用四位二进制并行加法器实现8421码转换成余3码的代码转换电路，是将输入8421码加上（）。

A.1100

B.0011

C.0001

D.0010

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第6题

用4位加法器74LS283和4位数值比较器74LS85设计一个4位二进制数转换成8421码的转换电路。

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第7题

试利用二进制并行加法器74LS283和必要的门电路组成1个二－十进制加法器电路（提示：根据BCD码中8421码的加法运

试利用二进制并行加法器74LS283和必要的门电路组成1个二-十进制加法器电路(提示：根据BCD码中8421码的加法运算规则，当两数之和小于等于9(1001)时，相加的结果与按二进制数相加所得到的结果一样。当两数之和大于9(即等于1010～1111)时，应按在二进制数相加的结果上加6(0110)，这样就可以给出进行信号，同时得到一个小于9的和)。

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第8题

下图所示组合逻辑电路，输入ABCD为8421码，则电路的输出WXYZ是（）

A.余3码

B.8421码对9的补码

C.8421码对6的补码

D.2421码

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第9题

下图所示组合逻辑电路，输入ABCD为8421码，则电路的输出WXYZ是（）

A.余3码

B.8421码对9的补数

C.8421码对6的补数

D.2421码

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第10题

用4位加法器74LS283和4位2选1数据选择器74LSl57设计一个双向码组转换器。当选择信号S=0时实现8421码到余3码

的转换；当S=1时实现余3码到8421码的转换。

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