题目内容（请给出正确答案）

[主观题]

某时序电路的状态转换真值表如下，其中e，i为输入，若采用d触发器来实现，则激励方程为

某时序电路的状态转换真值表如下，其中E，I为输入，若采用D触发器来实现，则激励方程为。对吗？

提问人：网友kenry1130 发布时间：2022-01-07

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第1题

如下图所示的SRAM存储器，包含了地址译码器，存储体，时序控制和读写电路共4个模块。若当前地址译码器的W1处于高电平，则下面说法正确的是（）

A、地址寄存器的值为100001（A5...A0）

B、地址寄存器的值为100000（A5...A0）

C、第1排（1,0），（1,1），...，（1,7)这八个存储元被选中，可以对其进行读写操作

D、第0列的64个存储元也会被选通，但只有（0,1）的数据能输出到读写电路

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第2题

已知某同步时序电路的状态转移表如表1所示。用JK触发器实现表1的表达式为（）

A、

B、

C、

D、

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第3题

已知时序电路的状态表如下表所示。如果电路的初始状态为a，输入信号A依次是1 0 1 0 1 1 1，试确定电路经历的状态，及输出序列。

A、abababdc，0101110

B、abababdc，0101010

C、ababebdc，0101010

D、abcbabdc，0111010

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第4题

某时序电路的状态图如图所示，设电路的初始状态为00，当序列A=110010自左至右输入时，该电路输出Z的序列为。

A、011101

B、101011

C、101110

D、101101

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第5题

已知某电平异步时序电路的总态图如下图4-1所示，请回答下述问题。

（1）完善流程表（不定状态和输出用d表示）。

（2）电路是否存在竞争，请说明在何种情况下会出现何种竞争？

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第6题

给出某个一般时序电路的图，有Tsetup、Tdelay、Tck->q，还有clock的delay，写出决定最大时钟的因素，同时给出表达式。

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第7题

某同步时序电路的状态图如下图所示，用D 触发器设计时的最简激励方程组为 ,电路能否自启动。

A、

B、

C、

D、

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第8题

某时序电路如图5．4．3所示，若在输出端Z得到10 kHz的矩形波，则该电路时钟脉冲CP的频率是________________。

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第9题

某同步时序电路及信号输入如下图所示，对应于CLK、X波形的Q1、Q0和Z的工作波形正确的是。（假设电路的初始状态为00）

A、

B、

C、

D、

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第10题

考虑一个标准积分电路，它的时间常数为1ms，初始输出为0，输入为一个脉冲串，它的脉宽为10μs，幅度为1V，并从0V开始上升。画出输出波形并标注。如果输出电压有1V的变化，则需要多少个脉冲？

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