题目内容
（请给出正确答案）
[主观题]
（22）不属于DFD（Data Flow Diagram，数据流图）的要素。如果使用DFD对某企业的财务系统进行建模，那么
该系统中（23）可以被认定为外部实体。
A.加工
B.联系
C.数据流
D.数据存储
提问人：网友memopo
发布时间：2022-01-06
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下列Verilog HDL程序所描述电路功能是（ ） module Dataflow( A, En, Y); input [2:0] A; //输入端口声明 input En; //输入端口声明 output [7:0]Y; //输出端口声明 assign Y[0] = ~( En & ~A[2] & ~A[1] & ~A[0] ); assign Y[1] = ~( En & ~A[2] & ~A[1] & A[0] ); assign Y[2] = ~( En & ~A[2] & A[1] & ~A[0] ); assign Y[3] = ~( En & ~A[2] & A[1] & A[0] ); assign Y[4] = ~( En & A[2] & ~A[1] & ~A[0] ); assign Y[5] = ~( En & A[2] & ~A[1] & A[0] ); assign Y[6] = ~( En & A[2] & A[1] & ~A[0] ); assign Y[7] = ~( En & A[2] & A[1] & A[0] ); endmodule
A、8/3线编码器
B、3/8线译码器
C、加法器
D、数据选择器
