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[主观题]

对于锁存器，当时钟CLK为高电平时，输出Q才随D输入的数据而改变；而当CLK为低电平时将保存其在高电平时锁入的数据。

提问人：网友cj821204 发布时间：2022-01-07

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第1题

ADC0890其基准电压输入脚+Vref=5V、-Vref=2V，当IN0口输入电压为分别3V和0V时，其转换后的十进制数字量分别

A、153、0

B、88、-170

C、88、0

D、153、102

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第2题

某锁存器电路如图4-5所示。已知输入信号的波形，分析输出Q的波形。设锁存器的初始状态为0.

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第3题

输入电路由按键S1～S8、锁存器D1、门电路D3、D4、D5组成。当八路锁存器DM74S373N的LE端为（）时，锁存器输入端(Dl-D8)的电平能直接送到相应的输出端(Ql-Q8)，当LE端变为（），锁存器封锁，即锁存器输入端的电平不能送到相应的输出端，各输出端保持封锁前的电平。

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第4题

假定锁存器的初始状态为0。对于下图所示的电路和输入波形，输出端Q 的波形图为。

A、

B、

C、

D、

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第5题

并行接口一般要对输出数据进行锁存，其原因是（）。

A、外设速度常低于主机速度

B、主机速度常低于外设速度

C、主机与外设速度通常差不多

D、要控制对多个外设的存取

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第6题

零地址指令的操作数一般隐含在______中。

A、数据暂存器

B、数据锁存器

C、寄存器

D、指令寄存器

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第7题

对于门控D锁存器来说，在条件下，输出端Q总是等于输入的数据D

A、使能脉冲之前

B、使能脉冲期间

C、使能脉冲之后的瞬间

D、任何时候

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第8题

下图所示D锁存器，只有当使能端E=1时，输入端D的值才会影响到Q的状态

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第9题

对于实用加法计数器，同步加载信号LOAD独立于时钟

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