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（请给出正确答案）
![[图][共20分]根据以下静态时序分析报告回答问题。 （1) ...[共20分]根据以下静态时序分析](http://static.jiandati.com/548eec7-chaoxing2016-647239.jpeg)
[共20分]根据以下静态时序分析报告回答问题。 (1) 这个报告是哪个EDA工具产生的？ (2) 报告最右侧一列中的“f”和“r”表示什么含义？ (3) 该报告描述的是建立时间还是保持时间？ (4) 该电路能跑的最高时钟频率为多少？ (5) 该报告是否能够求出保持时间？ (6) 该报告的数据与芯片布局布线之后的数据是否相同？芯片布局布线阶段与DC综合阶段，在处理时钟网络时有何不同？
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如果把上述电路整体看为一个触发器，请回答如下问题 (1)[20分]该电路的有效建立时间和保持时间是多少?请写出计算过程。 A. Tsetup = 4 ns, Thold = 1 ns B. Tsetup = 3 ns, Thold = 0 ns C. Tsetup = 3 ns, Thold = 1ns D. Tsetup = 2 ns, Thold = 0 ns (2) [20分]该电路的最高时钟频率为多少? 请写出计算过程。 A. 250 MHz B. 80 MHz C. 125 MHz D. 166.7 MHz (3) [10分]该电路的功能与下列哪个触发器相似?[B] A. D flip flop with enable B. T flip flop C. JK flip flop D. SR flip flop (4) [10分]对于一个同步电路，以下哪个公式可以用于计算最高工作频率？ A. Max Freq = 1/(Tprop_delay + Tsu + Thold) B. Max Freq = 1/(Tprop_delay + Tsu + Tco + Thold) C. Max Freq = 1/(Tsu + Tco + Thold + Tclock_skew) D. Max Freq = 1/(Tprop_delay + Tsu + Tco + Tclock_skew) E. Max Freq = 1/(Tprop_delay + Tsu + Thold + Tco + Tclock_skew)
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