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[单选题]

在低位四体交叉存储器中,若处理器要访问的地址(十进制)为3、6、9、12、…、300,则该存储器比单体存储器理论平均访问速度提高()倍。

A.1

B.2

C.3

D.4

提问人:网友ruochenxx 发布时间:2022-01-07
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第1题

1 由一个具有8个存储体的低位多体交叉存储体中,如果处理器的访存地址为以下八进制值。求该存储器比单体存储器的平均访问速度提高多少(忽略初启时的延时)? (1)1001,1002,1003,1004, 1005…, 1100 (2)1002,1004,1006,1010, 1012…. 1200 (3)1003,1006,1011,1014, 1017…, 1300

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第2题
设有4个模块组成的四体存储器结构,每个体的存储字长为32位,存储周期为300ns。假设数据总线宽度为32位,总线传输周期为50ns,则采用多体顺序存储方式存储器连续读出4个字的时间是_________ns。
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第3题
8086/8088 CPU系统中存储器的地址范围是 。

A、0000H~FFFFH

B、00000H~FFFFFH

C、00000000000000000000B~11111111111111111111B

D、0000000000000000B~1111111111111111B

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第4题
设由四个模块组成的四体存储器结构,每个体的存储字长为16位,存取周期为250ns,假设数据总线宽度为16位,总线传输周期为50ns,试求顺序存储和交叉存储的带宽分别为___bps

A、6.4*10^7 和 1.6*10^8

B、1.6*10^8 和 6.4*10^7

C、6.4*10^7 和 1.6*10^7

D、6.4*10^8 和 1.6*10^8

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第5题
AD7524的应用电路如下图所示,图中D0~D7为数据输入, 为片选信号, 为写入命令,电源 ,其输出电压为 V,分辨率为 mV。

A、- 6.37V,20.53mV

B、- 4.00V,17.36mV

C、- 4.37V,19.53mV

D、- 2.35V,49.53mV

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第6题
采用八体并行低位交叉存储器,设每个体的存储容量为32K x 16位,存储周期为400ns,下述说法中正确的是()

A、在400ns内,存储器可向CPU提供位二进制信息

B、在100ns内,存储器可向CPU提供位二进制信息

C、在400ns内,存储器可向CPU提供位二进制信息

D、在100ns内,存储器可向CPU提供位二进制信息

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第7题
设某微处理器系统地址线宽度为13bit,按字节编址,若指定采用全译码法,则采用1K×4bit的芯片组成存储系统时,最多可扩展的芯片数量是( )片。

A、8

B、16

C、20

D、24

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第8题
以下是有关IA-32中线性地址向物理地址转换过程的叙述,其中错误的是( )。

A、4GB线性地址空间被划分成1M个页面,每个页面大小为4KB

B、32位线性地址分成10位页目录索引、10位页表索引和12位页内偏移量三个字段

C、页目录表中的页目录项和页表中的页表项都占32位,且两者的结构完全相同

D、每次地址转换都需要先访问页目录表,然后访问页表,根据页表项得到物理地址

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第9题
下列ROM芯片地址输入端为8,数据输出端为4的是( )。

A、16×4bit

B、32×8bit

C、256×4bit

D、512×8bit

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