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[单选题]

module EXAPL(R); parameter S=4; output [2*S:1] R; integer A; reg [2*S:1] R; always@(A) begin R=A; end endmodule R经过A赋值后是多少位的:

A.32

B.16

C.8

D.4

提问人:网友rickyling 发布时间:2022-01-07
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第1题
位置关联法,关联表述的信号位置可以不固定:
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第2题
Y<=a;是:<br> A、连续赋值语句

B、阻塞式赋值

C、非阻塞式赋值

D、条件语句

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第3题
output signed [7:0] y; input signed [7:0] a; assign y=(a>>>2); 若a=10101011,则输出y等于:

A、00101010

B、10101100

C、11101010

D、10101111

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第4题
下列哪一个是正确的:

A、(3==5)=1

B、(3’bx10===4’b0x10)=0

C、(4’b0z10!==4’b0z10)=1

D、D. (8!=9)=0

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第5题
下面哪一个不是标识符:

A、模块名

B、信号名

C、关键词

D、端口名

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第6题
A=4’b1011, B=4’b1000,则下列正确的是:

A、(A>B)=1

B、(A<b)=1<br> C、(A>15)=1

D、(B<11)=0<br>

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第7题
使用Verilog设计一个8选1选择器
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第8题
若底层的模块语句和参数表述为module SUB #(parameter S1=5, parameter S2=8, parameter S3=1) (A,B,C); 在上层的例化语句中的表述为SUB #(.S1(7), .S2(3), .S3(9)) U1(.A(AP), .B(BP), .C(CP)); 则例化后,S2给定的值为:

A、8

B、3

C、9

D、7

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第9题
assign引导的连续赋值语句属于并行赋值语句吗
点击查看答案
第10题
端口名关联法,关联表述的信号位置可以不固定:
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