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要用VerilogHDL定义一个1KB的RAM空间,下列语句合适的是
A.reg [7:0] my_RAM[0:1023]
B.reg my_RAM[0:1023]
C.wire [7:0] my_RAM[0:1023]
D.wire my_RAM[0:1023]
A.reg [7:0] my_RAM[0:1023]
B.reg my_RAM[0:1023]
C.wire [7:0] my_RAM[0:1023]
D.wire my_RAM[0:1023]
A.reg [7:0] my_RAM[0:1023]
B.reg my_RAM[0:1023]
C.wire [7:0] my_RAM[0:1023]
D.wire my_RAM[0:1023]
A.output [7:0]OUT
B.output [8:0]OUT;
C.output [8]OUT;
D.output OUT[8];
A.codeunsignedcharx;
B.pdataunsignedcharx;
C.idataunsignedcharx;
D.xdataunsignedcharx;
A.EPROM只能写入一次,一经写入就不能修改。
B.存储器所具有的地址线的根数m反映了存储器的字数,如具有10根地址线的存储器容量为1KB。
C.常用的RAM有SRAM(静态RAM)、DRAM(动态RAM)等。
D.上面描述至少有一个不正确。
A.int data x[10];
B. int xdata x[10];
C. int code x[10];
D. int idata x[10];
已定义了一个类A并有语句 A* pa=new A(5); ,那么下列说法正确的是 【 】
A.该语句会创建A类的一个对象,并将此对象的地址赋给指针pa
B.该语句会创建A类的5个对象,且他们的地址是连续的
C.当指针变量pa超出其作用域时,pa和为对象分配的空间都将被自动释放
D.类A中一定有一个显式定义的构造函数和一个显式定义的虚析构函数
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