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[主观题]
对于下图所示由二--十进制译码器ct74ls42组成的逻辑电路，试写出
对于下图所示由二--十进制译码器CT74LS42组成的逻辑电路，试写出
、
、
的逻辑函数表达式，并用卡诺图法化简为最简与或式。
提问人：网友angusyyy
发布时间：2022-01-07
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第2题
二-十进制译码器74L$42的真值表如表所示，写出各个输出的逻辑表达式。
| 输入 | 输 出 |
| A3A2A1A0 | overline{Y}_{0}overline{Y}_{1}overline{Y}_{2}overline{Y}_{3}overline{Y}_{4}overline{Y}_{5}overline{Y}_{6}overline{Y}_{7}overline{Y}_{8}overline{Y}_{9} |
| 0 0 0 0 0 0 0 1 0 0 1 0 0 0 1 1 0 1 0 0 0 1 0 1 0 1 1 0 0 1 1 1 1 0 0 0 1 0 0 1 1 0 1 0 1 0 1 1 1 1 0 0 1 1 0 1 1 1 1 0 1 1 1 1 | 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 O 1 1 1 1 1 1 1 1 1 1 0 1 1 1 1 l 1 1 1 1 1 0 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 1 |
第4题
下图所示电路是用二-十进制优先编码器74LS147和同步十进制计数器74160组成的可控分频器，已知CP端输入脉冲的频率为10kHz。试说明当输入控制信号E为低电平时由Y端输出的脉冲频率为（ ）。 
A、2kHZ
B、2.5kHZ
C、5kHZ
D、0.625 kHZ
第6题
利用两片并行进位加法器74283和必要的门电路设计一个8421BCD码加法器。8421BCD码的运算规则是：当两数之和小于等于9（1001）时，所得结果即为输出；当所得结果大于9时，则应加上6（0110）。
第8题
由4位二进制数值比较器7485和4位二进制全加器74283构成的电路如下图所示。试分析当电路输入端A3A2A1A0输入为1001时，输出端S3S2S1S0的值为 。 
A、0110
B、1100
C、0101
D、1010
