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[单选题]
PLA和触发器组成的时序电路如下图所示,以下 不是JK触发器的激励方程。
PLA和触发器组成的时序电路如下图所示,以下 不是JK触发器的激励方程。![PLA和触发器组成的时序电路如下图所示,以下 不是JK触发器的激励方程。](https://img2.soutiyun.com/shangxueba/ask/19320001-19323000/19320415/dc19be7-chaoxing2016-170661.png)
A.
B.
C.
D.
E.
F.
提问人:网友szsofware
发布时间:2022-01-06
A.
B.
C.
D.
E.
F.
A、这是一个同步时序逻辑电路
B、这是一个异步时序逻辑电路
C、3个JK触发器均构成了T′ 触发器,所以都满足Q*=Q′
D、3个JK触发器均是下降沿触发,因此是主从结构的触发器
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